POWER2

A POWER2, korábbi elnevezésén RIOS2, egy az IBM által tervezett 32 bites RISC processzor, mely a POWER utasításkészlet-architektúrát implementálja. A POWER2 a POWER1 utódja volt, 1993 szeptemberében mutatkozott be az IBM RS/6000-es rendszereiben. Bevezetése idején a POWER2 volt a leggyorsabb mikroprocesszor, felülmúlva az Alpha 21064-et. 1993-ban azonban megjelent az Alpha 21064A változat, ekkor a POWER2 elvesztette a vezetést és második lett. Az IBM állítása szerint egy -en futó POWER2 processzor teljesítménye és .

A nyílt forráskódú GCC fordítóban a POWER1 (RIOS) és POWER2 (RIOS2) utasításkészletek támogatását a 4.5 verzióban megszüntették.http://gcc.gnu.org/gcc-4.5/changes.html

Leírás thumb|right|POWER2 MCM illusztráció

A POWER1-hez képest a processzorban számos fejlesztést hajtottak végre, ezek közé tartozik a továbbfejlesztett utasításkészlet-architektúra, amely új felhasználói és rendszerutasításokat kapott és újabb rendszerjellemzőkkel bővült (négyszavas betöltés/kiírás, nullaciklusos elágazások, hardveres négyzetgyökvonás stb.), a processzor órajelfrekvenciája megnövekedett (55 és között lehet), egy helyett két fixpontos egységet és ugyancsak két lebegőpontos egységet tartalmaz, és a gyorsítótárak méretét is megnövelték: a processzor 32 KiB-os utasítás-gyorsítótárat és 128 vagy 256 KiB adat-gyorsítótárat használhat.

A POWER2 egy többcsipes kialakítás, amely hat vagy nyolc, részben egyedi integrált áramkörből áll, az adat-gyorsítótár méretétől függően (a 256 KiB konfigurációhoz nyolc csip szükséges). A kialakítás alkotóelemei megegyeznek a POWER1-ével: egy utasítás-gyorsítótár egység, egy fixpontos egység, egy lebegőpontos egység, egy tárvezérlő egység és két vagy négy adat-gyorsítótár egység alkot egy processzort, külön csipekben.

A nyolccsipes konfiguráció összesen 23 millió tranzisztort tartalmaz és az összesített lapkafelület . A csipeket az IBM -es CMOS folyamatával gyártották,Gwennap 1996 melyet -es effektív csatornahossz, egy réteg poliszilícium és négy rétegű fémezés jellemez.White 1994 A csipek egy méretű kerámia többcsipes modulba (multi-chip module, MCM) vannak szerelve.

POWER2+ A POWER2+ a POWER2 egy javított, tranzakciófeldolgozásra optimalizált verziója. 1994 májusában mutatták be. A tranzakciófeldolgozási munkafolyamatok hatékonyságának fokozása céljából 512 KiB, 1 MiB és 2 MiB méretű második szintű gyorsítótárakkal bővítették ki. Az L2 gyorsítótár a tokon kívül helyezkedik el, ipari szabvány burst SRAM-okkal lett megvalósítva. A gyorsítótár a POWER2+ processzorhoz egy 64 bites (alsó kategóriás/belépő szintű rendszerekben) vagy 128 bites (felsőkategóriás rendszerekben) sínen keresztül kapcsolódik. A gyorsítótár közvetlen leképezésű, sorai (line) 128 bájt méretűek és átíró aktualizálást alkalmaz. A gyorsítótár címkéit (tags) a tárvezérlő egység csip tartalmazza. A POWER2+ egy keskenyebb 64 vagy 128 bites memóriasínt és egy kisebb 64 vagy 128 KiB méretű adat-gyorsítótárat tartalmaz. A kisebb gyorsítótár miatt az adat-gyorsítótár egység is kisebb csipeket igényel és az átdolgozott tárvezérlő egység csip szintén kisebb. A cél egy hatcsipes konfiguráció létrehozása volt, a költségek csökkentése érdekében, emiatt a csipek is forrasztógolyós (solder ball connect) (SBC) tokozásba kerültek MCM helyett.

POWER2 Super Chip – P2SC thumb|right|P2SC+ illusztráció A P2SC – a POWER2 Super Chip rövidítése – 1996 októberében jelent meg, mint az a POWER2 utódja. Ez a nyolc-csipes POWER2 egy csipen kivitelezett megvalósítása. 15 millió tranzisztort integrál egy lapkán. Az IBM -es öt fémrétegű CMOS-6S folyamatával gyártották. Az első verzió 120 vagy órajelen működhetett, így közel kétszer olyan gyors, mint a -en futó POWER2, miközben a memória és a bemeneti/kimeneti sínek fél órajel-sebességen futnak, ezáltal magasabb órajel-frekvenciát támogathatnak. Az IBM állítása szerint a P2SC teljesítménye és volt. Egy gyorsabb, -es órajelű változat is készült, -es CMOS-6S2 folyamattal, ezt a Microprocessor Forum-on jelentették be 1997 októberében.

A P2SC nem volt a POWER2 tökéletes másolata, az L1 adat-gyorsítótár és az adat-TLB (címfordító gyorsítótár) kapacitását megfelezték, így a gyorsítótár mérete 128 KiB lett, a TLB pedig 256 bejegyzést tartalmaz, és kihagyták belőle egy ritkán használt jellemző, a TLB-ben lévő bejegyzések lezárásának implementációját is, hogy az eredeti kialakítás elférjen egyetlen lapkán.

A P2SC-t a POWER3 követte, az IBM zászlóshajójaként az RS/6000 vonalban, 1998-ban. A P2SC egyik jelentős alkalmazása volt a 30 számítási csomópontot (processzort) tartalmazó IBM Deep Blue szuperszámítógép, ill. sakkszámítógép, ami sakkban legyőzte a világbajnok Garri Kaszparovot 1997-ben. Ugyanakkor a számítógép sakkozási képességei inkább a külön erre a célra tervezett egyedi integrált áramköröknek voltak köszönhetők, mint a P2SCs processzoroknak.

Jegyzetek

Fordítás

Források További információk

Ball, Richard (15 October 1997). "Chipville USA". Electronics Weekly. DeTar, Jim (22 August 1994). "IBM details Power2+; DEC bares new Alpha AXP". Electronic News. Gwennap, Linley (4 October 1993). "IBM Regains Performance Lead with Power2". Microprocessor Report. Gwennap, Linley (26 August 1996). "IBM Crams POWER2 onto Single Chip". Microprocessor Report.

Lineback, J. Robert (28 June 1993). "IBM readies RISC Progeny in Unix" . Electronic News. Shippy, David (9 August 1994). "The Power2+ Processor". Hot Chips 6.

Statt, Paul (January 1994). "Power2 Takes the Lead--For Now". Byte.

Kapcsolódó szócikkek IBM POWER utasításkészlet-architektúra IBM Power mikroprocesszorok POWER1 – előd POWER3 – utód

Kategória:IBM Kategória:IBM mikroprocesszorok